hideack
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テノニッキ (@hideack 's diary)
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仕事
回る回る。PCのファンが回る。 今朝から仕事。大学ノートに書いたタイミングチャート etc.. をもとにVHDLでコンポーネントを5個書き上げる。 テストベンチも書いた。甘いけど。 まずは問題なさそうなので、論理合成ということで1時間前から論理合成開始。終わらない。 時間があるのでメモを読み返す。 こういったものをレビューという形で客観的に見てもらえる人がいないところが寂しいところだ。 メモを見ながら思い出した。 前職時代、メモを十分に作り上げずVHDLを書いたので、どえらく怒られた記憶がある。 おまえみたいなやつが、いきなりVHDL書き出すのはxx年早い！！ そうか、死ぬまで無理だな。と思う…
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2008-09-28 21:07:07
しごとなざつだん。
rich
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