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  <blog_title>CPU実験室</blog_title>
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    <anon>表示器</anon>
    <anon>#工学</anon>
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  <description>消費電流を抑えるいくつかの手立てを行いました まず、システムクロックの低速化です うまくいけば計時用水晶のクロックを流用し32.768kHzまで落とせると思っていたのですが 低すぎると割込みに歯抜けが起きて時刻遅れが出てくることがわかり、とりあえず内蔵発振器の125ｋHzで 様子見しています 次に割り込み待ち中にSLEEPさせます。 ただし、ｓｌｅｅｐによりシステムクロックが停止している最中はＣＣＰのコンペアマッチ割込みではｗａｋｅｕｐできない ようなので、元通りタイマ１のオーバーフロー割込みを使用します。 このときタイマ初期値の再ロードもやめてフリーランにしています。 こうすると16ビットタ…</description>
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  <published>2012-07-13 00:08:41</published>
  <title>省電力化</title>
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